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PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，达到了既降低成本又提高系统性能的目的 CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态 L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率 CPU访问Cache“未命中”时，信息需从主存(DRA传送到CPU，这时CPU要插入等待状态
PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即，达到了即降低成本又提高系统性能的目的 CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态 CPU访问CaChe“未命中”时，信息需从主存(DRAM)传送到CPU，这时CPU要插入等待状态 L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率
SRAM有极高的读写速度及大容量 DRAM有极高的读写速度及大容量 SRAM有极高的读写速度，DRAM有更大的容量 DRAM有极高的读写速度，SRAM有更大的容量
cache中存放的只是主存储器中部分内容的映像 cache的工作方式可以根据需要由软件进行设置 cache与主存储器是两个各自独立的存储部件，可以选择使用其中的一个 cache通常是由DRAM制作的
从RAM读出数据后,原有存储单元内容不变 将数据写入RAM后,新写入的内容累加至元存储单元中 动态随机读写存储器(DRAM)就是常说的内存 目前使用的RAM多数为MOS型半导体集成电路
随机存储器 动态随机存储器 只读除存储器 可读写存储器
PC中采用的Cache方案兼顾了SRAM的高速特性和DRAM的低成本特性，即达到了即降低成本又提高系统性能的目的 CPU访问Cache“命中”时，由于Cache的速度与CPU相当，因此CPU就能在零等待状态下迅速地完成数据的读写，而不必插入等待状态 CPU访问CaChe“未命中”时，信息需从主存(DRA传送到CPU，这时CPU要插入等待状态 L1 Cache的工作频率和CPU的工作频率相等，L2 Cache的工作频率越来越高，但不可能等于CPU的工作频率
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