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由于门电路连接的级数愈多,导致输出的低电平接近高电平,怎样防止逻辑差错(  )。

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减小负载或分布电容  在与门及或门后加一级反相器  减小输出阻抗  调节三极管的静态工作点  
减小负载或分布电容  在与门及或门后加一级反相器  减小输出阻抗  调节三极管的静态工作点  
减小负载或分布电容  在与门及或门后加一级反向器  减小输出阻抗  调节三极管的静态工作点  
全为高电平  全为低电平  只要有一个低电平就行  
三个输入全为高电平  三个输入全为低电平  三个输入中一个为低电平  三个输入中一个为高电平  
全为高电平  全为低电平  只要有一个高电平就行  
CMOS的输出高电平比TTL的输出高电平高,低电平比TTL输出的低电平低  CMOS的输出高电平比TTL的输出高电平高,低电平比TTL输出的低电平高  CMOS的输出高电平比TTL的输出高电平低,低电平比TTL输出的低电平低  CMOS的输出高电平比TTL的输出高电平低,低电平比TTL输出的低电平高  
全部为高电平  至少一个端为低电平  全部为低电平  至少一个端为高电平  
全为高电平;  全为低电平;  只要有一个高电平;  只要有一个低电平;  
全为高电平  全为低电平  只要有一个是低电平就行  

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